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[主观题]

用触发器和门电路设计一个三入抢答电路。每个抢答者和裁判员各控制一个按钮。抢答开始后首先按下按钮者将他控制的一个触发器置1,以后其他入按下按钮不再能将所控制的触发器置1。开始抢答以前,裁判应按动按钮将三个触发器全部置0。

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第1题
触发器是一种由门电路构成并具有两个稳定状态的电路,两个稳定状态分别用来表示和寄存二进制数码()与().

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第2题
试设计一个8421BCD码校验电路。要求当输入量DCBA≤2,或≥7时,电路输出F为高电平,否则为低电平。用“与非”门设计实现该电路,写出F表达式。

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第3题
用二个运放设计一个实现的运算电路,画出电路图,标出各电阻值,电阻的阻值限在(1~500)kΩ之间。

用二个运放设计一个实现的运算电路,画出电路图,标出各电阻值,电阻的阻值限在(1~500)kΩ之间。

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第4题
用集成单稳态电路74121设计一个脉冲延迟电路,使输出脉冲较输入脉冲延迟0.5ms,如图P9.10所示。υ1
和υ0的脉冲宽度皆为0.3ms。

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第5题
图5.21表示一个时序状态机的状态转换图.该状态机有四个状态,在时钟作用下,状态机在四个状态之

图5.21表示一个时序状态机的状态转换图.该状态机有四个状态,在时钟作用下,状态

机在四个状态之间轮流转换.状态机的状态由A、B两个寄存器(触发器)定义:当A=0,B=1时,输出信号Y=0;其余A、B组合情况下,输出Y均为1.

用ISP器件设计该时序状态机,写出VHDL源文件.

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第6题
如果要求用计数器CT74161和4-16译码器设计一个12路输出的脉冲分配器,即从电路的12个输出端顺序、循环地输出与时钟正脉冲等宽的负脉冲,则电路应如何连接?试设计电路,井画出电路图.

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第7题
十进制加法系统参见图6.13所示,请设计一个计数器型控制器,规定采用D触发器.

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第8题
试判断图6.5由CMOS门电路组成的单稳态触发器中,为加大输出脉冲宽度所采用的下列措施哪些是对的
,哪些是错的.

(1)增大R1(2)减小R2(3)增大C2(4)增大VDD(5)加大输入脉冲宽度

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第9题
用一个触发器一个状态方法实现图题11.2.4所示的ASM图。

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第10题
阅读下列说明,回答问题1至问题3。【说明】 请设计一个图书馆数据库,此数据库中对每个借阅者保存的读

阅读下列说明,回答问题1至问题3。

【说明】

请设计一个图书馆数据库,此数据库中对每个借阅者保存的读者记录包括:读者号、姓名、地址、性别、年龄、单位。对每本书存有:书号、书名、作者、出版社。对每本书被借出的书存有读者号、借出日期和应还日期。

【问题1】

给出E-R图

【问题2】

转换成关系模型

【问题3】

给其中任何一个表用SQL语句建表。

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第11题
组合电路的真值表由下表所示,请用三输入与门、三输入或门及非门设计该电路.

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