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[主观题]

使用555定时器设计一个脉冲电路,555定时器原理图如图10.94所示.该电路振荡20s停止10s,然后在振

荡20s停止10s,并如此循环.该电路输出脉冲的振荡周期T为1s,占空比q=1/2.电容C的容量一律选取10μF.

使用555定时器设计一个脉冲电路,555定时器原理图如图10.94所示.该电路振荡20s停止10s,

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第1题
在图P9.21的多谐振荡电路中,若555定时器的电源电压为Vcc=10V,R1=22k2,R2=47ks,C=0.0
01μF,试计算当VCD端外加电压VE为4V和8V时输出脉冲的频率各等于多少。

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第2题
图6.12为以“555"定时器为核心的简易逻辑测试笔电路,用于测试数字电路的逻辑状态“0”和“1”,
测试结果用发光二极管LEDI和LED2指示.已知待测输入信号的频率约为1Hz左右或更低,Uco调到2.5v.

(1)说明“555"在这里被接成什么电路,并简述整个电路的工作原理.

(2)分别说明电位计Rw和LED1、LED2的作用.

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第3题
555定时器的最后数码为555的是()产品,为75555的是()产品.

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第4题
如要改变由555定时器组成的单稳态触发器的脉宽,可以采取哪些方法?

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第5题
用集成单稳态电路74121设计一个脉冲延迟电路,使输出脉冲较输入脉冲延迟0.5ms,如图P9.10所示。υ1
和υ0的脉冲宽度皆为0.3ms。

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第6题
如果要求用计数器CT74161和4-16译码器设计一个12路输出的脉冲分配器,即从电路的12个输出端顺序、循环地输出与时钟正脉冲等宽的负脉冲,则电路应如何连接?试设计电路,井画出电路图.

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第7题
某系统为了提高采样速率,采用4片模数(全并行A/D)转换器构成并行交替式数据采集系统,原理框图如

某系统为了提高采样速率,采用4片模数(全并行A/D)转换器构成并行交替式数据采集系统,原理框图如图7.20所示.系统信号源为30MHz的方波,时钟信号CLK为10MHz(要求占空比为1:1).并行交替式数据采集系统利用4片ADC轮流对同一个模拟输入信号进行采样,分别存人各路对应的64单元的存储器中,其对应各路AD所需的采样信号波形如图7.21所示,脉冲分配电路可用计数器+译码器构成.试根据系统设计参数要求,完成各部分电路的设计,器件任选.

(1)分频电路;

(2)脉冲分配电路;

(3)地址发生器电路设计;

(4)说明每个地址发生器所使用的时钟信号分别是什么?

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第8题
点火变压器的次级电路给火花塞产生一个8000£­32000V的脉冲,用来产生火花。()
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第9题
计数器的复位输入电路()、计数输入电路当前值()设定值时,每来一个(),计数器的当前值+1.计数当前
计数器的复位输入电路()、计数输入电路当前值()设定值时,每来一个(),计数器的当前值+1.计数当前

值等于设定值时,其常开触点()、常闭触点()。再来计数脉冲时当前值()。复位输电路()时,计数器被复位,复位后其常开触点()、常闭触点(),当前值为()。

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第10题
试设计一个码转换电路,将四位格雷码转换为自然二进制码,可以采用任何逻辑门电路实现。
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